![什麼是verilog]( "什麼是verilog")
- 1、Verilog是一種硬體描述語言，它最基本的功能，就是把一份電路圖用程式碼的形式表示出來，然後讓計算機理解一份程式碼所對應的電路。硬體描述語言有很多，現在主流的基本就是verilog，或者它的升級版systemverilog。2、Verilog程式碼和C、Java這種計算機程式語言有本質的不同，verilog裡...
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![何謂verilog]( "何謂verilog")
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